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全数字锁相环的设计及分析
全数字锁相环
FPGA
VHDL
数学模型
基于PI控制的全数字锁相环设计
比列积分控制
全数字锁相环
超高速集成电路硬件描述语言
现场可编程门阵列
基于FPGA的全数字延时锁相环的设计
全数字延时锁相环
锁相精度
时钟延时
QuartusⅡ
现场可编程门阵列
电路仿真
全数字锁相环及其数控振荡器的FPGA设计
全数字锁相环
数控振荡器
翻转触发器
VHDL
SoPC
FPGA
内容分析
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文献信息
篇名 全数字锁相环(DPLL)的设计方法
来源期刊 江南半导体通讯 学科 工学
关键词 锁相环 DPLL 设计 通信系统
年,卷(期) 1991,(6) 所属期刊栏目
研究方向 页码范围 17-21
页数 5页 分类号 TN911.8
字数 语种 中文
DOI
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1991(0)
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研究主题发展历程
节点文献
锁相环
DPLL
设计
通信系统
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
江南半导体通讯
双月刊
江苏省无锡市105信箱微电子技术编辑部
出版文献量(篇)
141
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