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摘要:
VHDL作为一种IEEE标准的电路硬件描述语言,正广泛地被电子技术人员使用.概要地介绍了布尔过程理论和VHDL标准语言,并对其在组合电路设计中的应用作一些探讨.
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内容分析
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文献信息
篇名 用VHDL语言实现基于布尔过程论的组合电路的设计
来源期刊 应用科技 学科 工学
关键词 布尔过程 VHDL 延时
年,卷(期) 2002,(10) 所属期刊栏目 计算机应用
研究方向 页码范围 32-35
页数 4页 分类号 TP355
字数 2880字 语种 中文
DOI 10.3969/j.issn.1009-671X.2002.10.011
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 马光胜 哈尔滨工程大学计算机科学与技术学院 74 240 8.0 12.0
2 高永红 哈尔滨工程大学计算机科学与技术学院 1 3 1.0 1.0
传播情况
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引文网络
引文网络
二级参考文献  (0)
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1996(1)
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2002(0)
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2008(2)
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2009(1)
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研究主题发展历程
节点文献
布尔过程
VHDL
延时
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
应用科技
双月刊
1009-671X
23-1191/U
大16开
哈尔滨市南通大街145号1号楼
14-160
1974
chi
出版文献量(篇)
4861
总下载数(次)
7
总被引数(次)
21528
论文1v1指导