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基于FPGA先进加密算法(AES)的并行实现
基于FPGA先进加密算法(AES)的并行实现
作者:
佟玉伟
李明
柯善学
陆浪如
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
密钥扩展
流水线
可编程逻辑阵列
摘要:
讨论了AES算法的并行特性,提出在明文分组和密钥分组都是128位的情况下,采用内部流水结构和并行密钥处理策略,在现场可编程门阵列上的一种并行的快速ASIC实现方案,并对整个系统的关键性能指标进行了讨论.
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文献信息
篇名
基于FPGA先进加密算法(AES)的并行实现
来源期刊
交通与计算机
学科
工学
关键词
密钥扩展
流水线
可编程逻辑阵列
年,卷(期)
2002,(6)
所属期刊栏目
研究与探讨
研究方向
页码范围
20-22
页数
3页
分类号
TP3
字数
2639字
语种
中文
DOI
10.3963/j.issn.1674-4861.2002.06.007
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
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1
李明
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佟玉伟
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陆浪如
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柯善学
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研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
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主办单位:
武汉理工大学
交通计算机应用信息网
出版周期:
双月刊
ISSN:
1674-4861
CN:
42-1781/U
开本:
大16开
出版地:
武汉市武昌和平大道1178号
邮发代号:
38-94
创刊时间:
1983
语种:
chi
出版文献量(篇)
3739
总下载数(次)
14
总被引数(次)
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