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摘要:
VHDL语言的逻辑综合就是将较高抽象层次的描述自动转换到较低抽象层次描述的一种方法.本文对VHDL语言综合进程作了详细的讨论,认为综合过程就是将RTL级描述、对设计的电路约束和属性及工艺库这些输入产生一个优化的门级网表.
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内容分析
关键词云
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文献信息
篇名 VHDL语言逻辑综合的研究
来源期刊 电测与仪表 学科 工学
关键词 VHDL 逻辑综合 描述
年,卷(期) 2002,(8) 所属期刊栏目 微机应用与接口
研究方向 页码范围 36-38,57
页数 4页 分类号 TP312
字数 3304字 语种 中文
DOI 10.3969/j.issn.1001-1390.2002.08.010
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 熊国海 三峡大学电气学院 16 45 4.0 6.0
2 刘新云 华中科技大学材料科学与工程学院 1 3 1.0 1.0
传播情况
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引文网络
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研究主题发展历程
节点文献
VHDL
逻辑综合
描述
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电测与仪表
半月刊
1001-1390
23-1202/TH
大16开
哈尔滨市松北区创新路2000号
14-43
1964
chi
出版文献量(篇)
7685
总下载数(次)
22
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