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摘要:
直接数字式频率合成器(DDS)是一种全数字器件,它不可避免地会引入杂散信号.杂散多且较难预知一直是限制DDS应用的主要因素.文章对DDS的杂散进行了分析,并采用Verilog HDL,设计了一种减少杂散的DDS改进结构.Matlab分析结果表明,所设计的DDS杂散波明显减少,信噪比提高了36 dB.
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用VHDL设计直接数字频率合成器
直接数字频率合成器(DDFS)
FPGA
VHDL
EDA
基于DSP控制的直接数字频率合成器的实现
DDS
相位调整
频率控制字
AD9858
内容分析
关键词云
关键词热度
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文献信息
篇名 一种减少杂散的直接数字频率合成器改进结构
来源期刊 微电子学 学科 工学
关键词 直接数字式频率合成器 频率合成 相位截断误差 Verilog HDL
年,卷(期) 2002,(2) 所属期刊栏目 研究论文
研究方向 页码范围 117-119,123
页数 4页 分类号 TN431.2
字数 2152字 语种 中文
DOI 10.3969/j.issn.1004-3365.2002.02.009
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 谈宜育 南京大学电子科学与工程系 8 62 5.0 7.0
2 李元 南京大学电子科学与工程系 18 110 6.0 10.0
3 单鸣 南京大学电子科学与工程系 1 9 1.0 1.0
传播情况
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引文网络
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2008(1)
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2009(3)
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2013(1)
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  • 二级引证文献(0)
研究主题发展历程
节点文献
直接数字式频率合成器
频率合成
相位截断误差
Verilog HDL
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
微电子学
双月刊
1004-3365
50-1090/TN
大16开
重庆市南坪花园路14号24所
1971
chi
出版文献量(篇)
3955
总下载数(次)
20
总被引数(次)
21140
论文1v1指导