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摘要:
千兆硬件防火墙将在网络安全体系中起到非常重要的作用,数据缓冲是连接MAC与规则匹配和状态检测的枢纽.高速数据缓冲的良好设计是突破吞吐速率瓶颈的关键.提出了一种基于FPGA的千兆硬件防火墙高速数据缓冲的实现方法,订制并精简了WISHBONE总线互连的方式,提出MAC与数据缓冲数据透明的设计方案从而大大提高通讯性能,给出了利用FPGA的BLOCK RAM实现同步/异步FIFO的一般方法,提出延迟判定和数据预取的方式解决空满判定和串联BLOCK RAM访问时延问题.高速数据缓冲的设计具有一定的通用性.
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文献信息
篇名 基于FPGA的千兆硬件防火墙高速数据缓冲设计
来源期刊 哈尔滨商业大学学报(自然科学版) 学科 经济
关键词 FPGA WISHBONE 数据缓冲 FIFO 预取
年,卷(期) 2004,(5) 所属期刊栏目 计算机工程
研究方向 页码范围 519-522,528
页数 5页 分类号 F393
字数 5643字 语种 中文
DOI 10.3969/j.issn.1672-0946.2004.05.005
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 季振洲 哈尔滨工业大学计算机科学与工程系 81 385 9.0 15.0
2 唐朔飞 哈尔滨工业大学计算机科学与工程系 21 104 5.0 9.0
3 王洁 哈尔滨工业大学计算机科学与工程系 5 22 2.0 4.0
4 胡铭增 哈尔滨工业大学计算机科学与工程系 1 1 1.0 1.0
传播情况
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引文网络
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参考文献  (2)
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1973(1)
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研究主题发展历程
节点文献
FPGA
WISHBONE
数据缓冲
FIFO
预取
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
哈尔滨商业大学学报(自然科学版)
双月刊
1672-0946
23-1497/N
大16开
哈尔滨市道里区通达街138号
1980
chi
出版文献量(篇)
3911
总下载数(次)
16
总被引数(次)
20147
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