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摘要:
速度与面积是数字集成电路设计的两个重要目标,由于它们之间通常是一种相互制约的关系,所以往往要在一定程度上进行折中.作者提出的改进方法可以在几乎不增加硬件面积的条件下有效地提高速度.
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内容分析
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文献信息
篇名 一种Montgomery模乘算法硬件实现的改进电路
来源期刊 北京大学学报(自然科学版) 学科 工学
关键词 Montgomery RSA VLSI硬件实现
年,卷(期) 2004,(1) 所属期刊栏目
研究方向 页码范围 80-84
页数 5页 分类号 TN431.2|TN492
字数 3322字 语种 中文
DOI 10.3321/j.issn:0479-8023.2004.01.011
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 张怡浩 北京大学微电子学系 4 6 2.0 2.0
2 于敦山 北京大学微电子学系 29 66 4.0 6.0
3 盛世敏 北京大学微电子学系 18 81 5.0 9.0
4 田则 北京大学微电子学系 1 3 1.0 1.0
传播情况
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引文网络
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二级参考文献  (6)
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  • 二级引证文献(2)
研究主题发展历程
节点文献
Montgomery
RSA
VLSI硬件实现
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
北京大学学报(自然科学版)
双月刊
0479-8023
11-2442/N
16开
北京海淀北京大学校内
2-89
1955
chi
出版文献量(篇)
3152
总下载数(次)
8
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52842
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