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摘要:
本文提出了一种高效的复信号处理芯片的设计方法.本芯片是某雷达信号处理机的一部分,接收3组ADC的输出复数据,依次完成去直流、加窗、512点FFT、求功率谱和累加3组信号的功率谱等功能.在这5种功能中,加窗、512点FFT和求功率谱复用一个蝶形单元.本芯片由单片FPGA实现,计算精度高、速度较快,满足雷达系统的实时处理要求.
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文献信息
篇名 一种高效的复信号处理芯片设计
来源期刊 电子设计应用 学科 工学
关键词 FFT 蝶形单元 块浮点 功率谱 FPGA
年,卷(期) 2004,(1) 所属期刊栏目 IC设计
研究方向 页码范围 28-31
页数 4页 分类号 TN4
字数 3265字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 陈禾 北京理工大学电子工程系 62 493 15.0 19.0
2 刘明 北京理工大学电子工程系 14 69 4.0 8.0
传播情况
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2008(1)
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研究主题发展历程
节点文献
FFT
蝶形单元
块浮点
功率谱
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子设计应用
月刊
1672-139X
11-4916/TN
大16开
北京市
82-839
2002
chi
出版文献量(篇)
3145
总下载数(次)
1
总被引数(次)
7284
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