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摘要:
VME总线为单处理器和多处理器的8位、16位、32位和64位并行传输的计算机体系建立了规范框架.本文简要地介绍了作为机载计算机首选的高性能总线-VME总线的主要特征,给出了使用CPLD设计VME总线控制器的逻辑方法,在各类功能模块通讯接口设计中具有典型性和实用性.
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基于ARM&CPLD分立器件测试主机总线控制器
ARM
CPLD
分立器件测试系统
测试主机系统总线控制器
内容分析
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文献信息
篇名 基于CPLD的机载计算机VME总线从方控制器设计
来源期刊 世界电子元器件 学科 工学
关键词 VME总线 菊花链 可编程逻辑器件
年,卷(期) 2004,(2) 所属期刊栏目 可编程逻辑器件
研究方向 页码范围 64-66
页数 3页 分类号 TP3
字数 2552字 语种 中文
DOI 10.3969/j.issn.1006-7604.2004.02.021
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 姜运生 中国航空计算技术研究所一室 36 72 4.0 8.0
2 王国东 中国航空计算技术研究所一室 13 18 3.0 4.0
3 阎稳 中国航空计算技术研究所一室 4 7 1.0 2.0
传播情况
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研究主题发展历程
节点文献
VME总线
菊花链
可编程逻辑器件
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
世界电子元器件
月刊
1006-7604
11-3540/TN
16开
北京市北四环西路67号大地科技大厦1201-1218
82-796
1995
chi
出版文献量(篇)
5855
总下载数(次)
6
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