原文服务方: 现代电子技术       
摘要:
阻塞与非阻塞过程赋值在Verilog语言中是最容易混淆的两种结构,正确理解两者在仿真和综合中的区别是很困难的.阻塞与非阻塞过程赋值的误用不仅在仿真时会产生一些逻辑错误,而且会造成仿真与综合的不一致,更为严重的是往往这种错误不易被发现.为解决这一问题,必须深刻理解阻塞与非阻塞过程赋值的功能和执行过程的本质区别.并在此基础上运用一些可以产生可综合逻辑并能避免仿真错误的重要的编码风格,才可以有效地避免阻塞与非阻塞过程赋值的误用.
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内容分析
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文献信息
篇名 Verilog HDL中阻塞与非阻塞过程赋值的区别与应用
来源期刊 现代电子技术 学科
关键词 Verilog HDL 阻塞式过程赋值 非阻塞式过程赋值 有限状态机
年,卷(期) 2005,(18) 所属期刊栏目 微电子技术
研究方向 页码范围 99-101
页数 3页 分类号 TP312
字数 语种 中文
DOI 10.3969/j.issn.1004-373X.2005.18.040
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 梁齐 合肥工业大学理学院 47 197 7.0 10.0
2 王宗宝 合肥工业大学理学院 2 5 1.0 2.0
传播情况
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引文网络
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2005(0)
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研究主题发展历程
节点文献
Verilog HDL
阻塞式过程赋值
非阻塞式过程赋值
有限状态机
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
现代电子技术
半月刊
1004-373X
61-1224/TN
大16开
1977-01-01
chi
出版文献量(篇)
23937
总下载数(次)
0
总被引数(次)
135074
  • 期刊分类
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