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摘要:
介绍了二进制互补Colay序列及其FPGA(现场可编程门阵列)实现.首先介绍了Go-lay序列递归生成方式,由此导出了高效Golay序列相关器的滤波器实现结构.高效Golay序列相关器算法实现复杂度低,特别适用于高速数据传输的情况.然后介绍了基于FPGA的实现方案,并且进一步提出了改进方案,大大节省了硬件资源.相对于传统的串行或并行相关器,高效Golay序列相关器在节约硬件资源和提高工作频率上都有很大的优势.硬件仿真结果表明,该结构能满足高速数据传输的快速计算要求,且硬件资源占用很少.
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文献信息
篇名 高效Golay序列相关器的FPGA实现
来源期刊 电子工程师 学科 工学
关键词 移动通信 同步 Golay 互补序列 高效Golay序列相关器 FPGA
年,卷(期) 2006,(2) 所属期刊栏目 通信技术
研究方向 页码范围 13-15
页数 3页 分类号 TN929.5
字数 2215字 语种 中文
DOI 10.3969/j.issn.1674-4888.2006.02.004
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 尤肖虎 东南大学移动通信国家重点实验室 211 1862 21.0 35.0
2 高西奇 东南大学移动通信国家重点实验室 80 611 12.0 22.0
3 潘志文 东南大学移动通信国家重点实验室 27 175 7.0 12.0
4 沈慧叶 东南大学移动通信国家重点实验室 1 7 1.0 1.0
传播情况
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研究主题发展历程
节点文献
移动通信
同步
Golay 互补序列
高效Golay序列相关器
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
信息化研究
双月刊
1674-4888
32-1797/TP
大16开
江苏省南京市
28-251
1975
chi
出版文献量(篇)
4494
总下载数(次)
11
总被引数(次)
24149
论文1v1指导