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摘要:
在数字滤波、离散傅里叶变换等数字信号处理中,乘法运算是一个最基本的运算,乘法运算的速度决定着数字系统的运算速度.本文通过理论与实验研究相结合的方法介绍CSD编码乘法器的运算法则及其在FPGA中的实现过程.通过与二进制乘法器相比较,证明CSD编码乘法器在减少对FPGA资源的占用和提高运算速度方面具有明显的效果.
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文献信息
篇名 基于FPGA的CSD编码乘法器
来源期刊 电子测量技术 学科 工学
关键词 CSD编码 乘法器 FPGA
年,卷(期) 2006,(4) 所属期刊栏目 可编程器件应用
研究方向 页码范围 87-88
页数 2页 分类号 TP3
字数 734字 语种 中文
DOI 10.3969/j.issn.1002-7300.2006.04.040
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 何永泰 楚雄师范学院物理与电子科学系 38 163 7.0 11.0
2 黄文卿 楚雄师范学院物理与电子科学系 6 27 2.0 5.0
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研究主题发展历程
节点文献
CSD编码
乘法器
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子测量技术
半月刊
1002-7300
11-2175/TN
大16开
北京市东城区北河沿大街79号
2-336
1977
chi
出版文献量(篇)
9342
总下载数(次)
50
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