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摘要:
利用准循环LDPC码的结构特点,使用半并行结构的译码器可以实现复杂度和译码速率的有效折中.提出了一种半并行结构的实现方法,并通过FPGA上的实现验证了性能.
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低密度奇偶校验码
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卷积神经网络
遗传算法
内容分析
关键词云
关键词热度
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文献信息
篇名 准循环LDPC码的半并行译码器设计
来源期刊 电视技术 学科 工学
关键词 LDPC码 最小和算法 半并行结构
年,卷(期) 2006,(2) 所属期刊栏目 电路与应用
研究方向 页码范围 24-26
页数 3页 分类号 TN941.1
字数 2048字 语种 中文
DOI 10.3969/j.issn.1002-8692.2006.02.007
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 杨知行 清华大学数字电视技术研究中心 69 681 16.0 24.0
2 潘长勇 清华大学数字电视技术研究中心 83 514 14.0 19.0
3 王军 清华大学数字电视技术研究中心 54 518 13.0 21.0
4 林之初 清华大学数字电视技术研究中心 2 27 2.0 2.0
传播情况
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引文网络
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2006(1)
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2020(2)
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研究主题发展历程
节点文献
LDPC码
最小和算法
半并行结构
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电视技术
月刊
1002-8692
11-2123/TN
大16开
北京市朝阳区酒仙桥北路乙7号(北京743信箱杂志社)
2-354
1977
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