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摘要:
提高功能部件的并行性是开发高性能微处理器的基本途径.在RISC处理器中设计独立的地址产生器可实现算术运算与地址运算并行处理,从而提高RISC处理器的性能.文中根据现今RISC处理器中常用的寻址方式,提出了一种RISC地址产生器生成算法并进行了实例化.实例化结果可作为IP核应用到RISC处理器的设计中.
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文献信息
篇名 一种RISC地址产生器生成算法的设计与实例化
来源期刊 计算机技术与发展 学科 工学
关键词 RISC处理器 并行性 寻址方式 地址产生器
年,卷(期) 2006,(1) 所属期刊栏目 智能、算法、软件工程
研究方向 页码范围 23-26
页数 4页 分类号 TP302
字数 3058字 语种 中文
DOI 10.3969/j.issn.1673-629X.2006.01.008
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 车德亮 17 53 4.0 7.0
2 赵宁 8 41 4.0 6.0
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研究主题发展历程
节点文献
RISC处理器
并行性
寻址方式
地址产生器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机技术与发展
月刊
1673-629X
61-1450/TP
大16开
西安市雁塔路南段99号
52-127
1991
chi
出版文献量(篇)
12927
总下载数(次)
40
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