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摘要:
根据系统高速、稳定的要求,采用FPGA技术实现了针对(2,1,7)卷积编码的软判决Viterbi译码器.考虑到芯片的速度、面积和功耗,通过对Viterbi译码和前端接口部分设计的若干优化算法进行研究和讨论,选择4bit量化、差分软译码、大回朔深度和最小状态判决准则等方案以保证性能.采用全并行ACS结构和寄存器交换法以提高速度,并且采用分支度量预计算、度量存储溢出控制及对译码器其他部分的优化设计,在保证时序稳定的情况下有效减少了硬件消耗.
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文献信息
篇名 基于FPGA的软判决Viterbi译码实现
来源期刊 电子技术 学科 工学
关键词 软判决Viterbi译码器 差分软译码 FPGA
年,卷(期) 2007,(9) 所属期刊栏目 应用设计
研究方向 页码范围 57-59
页数 3页 分类号 TP3
字数 2789字 语种 中文
DOI 10.3969/j.issn.1000-0755.2007.09.013
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 张辉 74 764 12.0 25.0
2 强晔 2 1 1.0 1.0
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研究主题发展历程
节点文献
软判决Viterbi译码器
差分软译码
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电子技术
月刊
1000-0755
31-1323/TN
大16开
上海市长宁区泉口路274号
4-141
1963
chi
出版文献量(篇)
5480
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19
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