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摘要:
为了减少基于提升的二维离散小波变换(DWT)VLSI结构设计中的片内存储需求,采用了一种新颖的调度方法,通过读取少量数据进行行滤波操作,并实现和列滤波的并行处理,有效地减少了片内存储容量.此外,行滤波和列滤波变换内部结构采用流水线设计方法,加快了运算速度,提高了硬件资源利用率,减小了电路的规模,并且这种基于提升的9/7离散小波变换二维结构很方便兼容5/3滤波器.经过Verilog HDL仿真验证,结果表明,在50MHz系统时钟下,采用9/7滤波器经3级分解,每秒钟可处理21帧大小为1280×1024×8bit的灰白图像.
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内容分析
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文献信息
篇名 一种低存储需求的二维DWT VLSI结构设计方法
来源期刊 电路与系统学报 学科 工学
关键词 离散小波变换 VLSI 提升算法 9/7滤波器
年,卷(期) 2007,(3) 所属期刊栏目 研究简报
研究方向 页码范围 131-135
页数 5页 分类号 TN402
字数 1999字 语种 中文
DOI 10.3969/j.issn.1007-0249.2007.03.028
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 王国雄 浙江大学超大规模集成电路设计研究所 20 98 6.0 9.0
2 金文光 浙江大学信息与电子工程系 39 179 7.0 11.0
3 杨崇朋 浙江大学信息与电子工程系 2 3 1.0 1.0
传播情况
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研究主题发展历程
节点文献
离散小波变换
VLSI
提升算法
9/7滤波器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电路与系统学报
双月刊
1007-0249
44-1392/TN
16开
广东省广州市
1996
chi
出版文献量(篇)
2090
总下载数(次)
5
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