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摘要:
提出了一种快捕获,低抖动,宽调节范围的增益自适应锁相环的设计.在这个方案中,采用了双边触发的鉴频鉴相器(dual-edge-triggered phase frequency detector)和自调节压控振荡器(self-regulated voltage controlled oscillator)并进行了详细的分析.芯片的加工工艺是0.5μm 1P3M CMOS标准数字逻辑工艺.测试结果表明输入频率变化在捕获范围的37%时,捕获时间为150ns;输出频率为640MHz时,均方根抖动为39ps.
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文献信息
篇名 一种快捕获宽调节范围的锁相环
来源期刊 半导体学报 学科 工学
关键词 锁相环 快捕获 低抖动 宽调节范围
年,卷(期) 2007,(3) 所属期刊栏目 研究论文
研究方向 页码范围 365-371
页数 7页 分类号 TN402
字数 1275字 语种 中文
DOI 10.3321/j.issn:0253-4177.2007.03.010
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 贾嵩 北京大学微电子学研究所 19 79 5.0 8.0
2 吉利久 北京大学微电子学研究所 47 298 11.0 15.0
3 叶红飞 北京大学微电子学研究所 8 29 3.0 5.0
4 葛岩 北京大学微电子学研究所 1 13 1.0 1.0
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研究主题发展历程
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锁相环
快捕获
低抖动
宽调节范围
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半导体学报(英文版)
月刊
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11-5781/TN
大16开
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2-184
1980
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