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面向嵌入式应用的内存管理单元设计
面向嵌入式应用的内存管理单元设计
作者:
严晓浪
刘坤杰
游海亮
葛海通
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
内存管理单元
转译缓存
片上系统
摘要:
提出了一种面向嵌入式应用的内存管理单元(MMU)的全综合设计结构,其地址转译缓存(TLB)采用多级结构,包括第一级分离的组相联微指令μITLB和微数据μDTLB及第二级统一的全相联JTLB.第一级μITLB和μDTLB表项少且组相联,查询速度快;第二级JTLB可采用多周期查询方式,易于高速综合实现.选取Mibench测试基准集中的部分典型应用,通过嵌入式片上系统(SoC)设计样例,验证了该MMU结构的应用适应性.SoC设计实验结果表明,多级TLB结构MMU的系统性能与单级全相联结构最大仅相差3.8%.将设计的MMU集成在自主开发的高端32-bit嵌入式芯核CK520中,在0.18 μm 6层金属工艺最差工作条件下,处理器的时钟频率达到230 MHz以上,面积仅增加了7.6%.
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相关文献总数
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(/年)
文献信息
篇名
面向嵌入式应用的内存管理单元设计
来源期刊
浙江大学学报(工学版)
学科
工学
关键词
内存管理单元
转译缓存
片上系统
年,卷(期)
2007,(7)
所属期刊栏目
自动化技术、计算机技术
研究方向
页码范围
1078-1082,1087
页数
6页
分类号
TP303
字数
2440字
语种
中文
DOI
10.3785/j.issn.1008-973X.2007.07.005
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
严晓浪
浙江大学超大规模集成电路设计研究所
246
1634
19.0
29.0
2
葛海通
浙江大学超大规模集成电路设计研究所
52
293
8.0
14.0
3
刘坤杰
浙江大学超大规模集成电路设计研究所
5
23
2.0
4.0
4
游海亮
浙江大学超大规模集成电路设计研究所
1
15
1.0
1.0
传播情况
被引次数趋势
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引文网络
引文网络
二级参考文献
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共引文献
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参考文献
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节点文献
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同被引文献
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二级引证文献
(6)
1996(2)
参考文献(0)
二级参考文献(2)
2004(1)
参考文献(1)
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引证文献(1)
二级引证文献(0)
2017(2)
引证文献(0)
二级引证文献(2)
2019(1)
引证文献(0)
二级引证文献(1)
研究主题发展历程
节点文献
内存管理单元
转译缓存
片上系统
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
浙江大学学报(工学版)
主办单位:
浙江大学
出版周期:
月刊
ISSN:
1008-973X
CN:
33-1245/T
开本:
大16开
出版地:
杭州市浙大路38号
邮发代号:
32-40
创刊时间:
1956
语种:
chi
出版文献量(篇)
6865
总下载数(次)
6
总被引数(次)
81907
相关基金
国家高技术研究发展计划(863计划)
英文译名:
The National High Technology Research and Development Program of China
官方网址:
http://www.863.org.cn
项目类型:
重点项目
学科类型:
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