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基于FPGA的神经网络硬件实现方法
基于FPGA的神经网络硬件实现方法
作者:
万勇
李占才
李昂
王沁
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
神经网络
FPGA
可重构
脉动阵列
摘要:
提出了一种可以灵活适应不同的工程应用中神经网络在规模、拓扑结构、传递函数和学习算法上的变化,并能及时根据市场需求快速建立原型的神经网络硬件可重构实现方法.对神经网络的可重构特征进行了分析,提出了三种主要的可重构单元;研究了可重构的脉动体系结构及BP网络到该结构映射算法;探讨了具体实现的相关问题.结果表明,这种方法不仅灵活性强,其实现的硬件也有较高的性价比,使用一片FPGA中的22个乘法器工作于100 MHz时,学习速度可达432 MCUPS.
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文献信息
篇名
基于FPGA的神经网络硬件实现方法
来源期刊
北京科技大学学报
学科
工学
关键词
神经网络
FPGA
可重构
脉动阵列
年,卷(期)
2007,(1)
所属期刊栏目
控制与决策
研究方向
页码范围
90-95
页数
6页
分类号
TP3
字数
4808字
语种
中文
DOI
10.3321/j.issn:1001-053X.2007.01.020
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
李占才
北京科技大学信息工程学院
25
263
9.0
15.0
2
王沁
北京科技大学信息工程学院
145
1212
18.0
29.0
3
李昂
北京科技大学信息工程学院
12
108
5.0
10.0
4
万勇
北京科技大学信息工程学院
10
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研究主题发展历程
节点文献
神经网络
FPGA
可重构
脉动阵列
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
工程科学学报
主办单位:
北京科技大学
出版周期:
月刊
ISSN:
2095-9389
CN:
10-1297/TF
开本:
大16开
出版地:
北京海淀区学院路30号
邮发代号:
创刊时间:
1955
语种:
chi
出版文献量(篇)
4988
总下载数(次)
18
总被引数(次)
47371
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