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摘要:
流水线技术是设计高速数字电路的最佳选择之一,本文对流水线工作原理作了较形象的描述.针对加法器在数字信号处理中的重要作用,本文讨论了在FPGA中设计流水线加法器的设计方法,采用VHDL硬件描述语言在QUARTUSⅡ6.0软件环境下对不同位宽的加法器性能进行仿真实验对比,说明了流水线技术在FPGA上设计的可行性与高速性,对加速数字信号处理有重要的实际应用价值.
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文献信息
篇名 基于FPGA的流水线技术应用研究
来源期刊 电子测量技术 学科 工学
关键词 流水线 FPGA VHDL 加法器
年,卷(期) 2007,(2) 所属期刊栏目 可编程器件应用
研究方向 页码范围 131-132,175
页数 3页 分类号 TP3
字数 1577字 语种 中文
DOI 10.3969/j.issn.1002-7300.2007.02.042
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 李旭 西北工业大学电子信息学院 19 79 4.0 8.0
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VHDL
加法器
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期刊影响力
电子测量技术
半月刊
1002-7300
11-2175/TN
大16开
北京市东城区北河沿大街79号
2-336
1977
chi
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