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摘要:
为了与10Gb/s的带宽相匹配,万兆以太网MAC层内部采用64位数据宽度,156.25MHz的工作频率.数据宽度的加宽和频率的提高给万兆以太网MAC层控制器的实现带来了新的挑战.这些挑战表现在数据域边界获取,CRC编码/校验,高频电路设计以及与千兆以太网兼容等方面.文章提出了使用辅助计数、交叉流水CRC、细化流水级和异步RAM等方案来解决这些问题,并采用上述解决方案设计实现了万兆以太网MAC层控制器.对控制器进行后时序仿真的结果证实了方案的正确性和可行性.
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万兆以太网MAC层控制器的FPGA设计与实现
万兆以太网
MAC通信协议
Virtex6 FPGA
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文献信息
篇名 万兆以太网媒体访问控制层研究
来源期刊 计算机工程 学科 工学
关键词 万兆以太网 MAC XGMII CRC 后时序仿真
年,卷(期) 2007,(17) 所属期刊栏目 博士论文
研究方向 页码范围 31-33,42
页数 4页 分类号 TP393.02
字数 2888字 语种 中文
DOI 10.3969/j.issn.1000-3428.2007.17.011
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 李磊 中国科学院计算技术研究所 142 2447 19.0 47.0
5 陈明宇 中国科学院计算技术研究所 40 463 10.0 21.0
6 曹政 中国科学院计算技术研究所 12 39 3.0 6.0
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研究主题发展历程
节点文献
万兆以太网
MAC
XGMII
CRC
后时序仿真
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
出版文献量(篇)
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