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摘要:
给出了基于SOVA算法的Turbo译码器的硬件设计系统结构,通过对关键模块的硬件资源占有及译码时序的分析,提出了减少硬件资源、降低硬件功耗以及提高译码速度、减少译码时延的优化设计方案.采用NC Simulator的仿真分析以及Cyclone II系列FPGA芯片的硬件测试表明,该文提出的优化设计方案减少了约40%的硬件资源,且译码速度提高了约60%,达到了降低功耗和提高速度的双重功效.
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文献信息
篇名 基于SOVA算法的Turbo译码器的设计与优化
来源期刊 计算机工程 学科 工学
关键词 SOVA算法 Turbo译码器 硬件设计 优化
年,卷(期) 2007,(7) 所属期刊栏目 工程应用技术及实现
研究方向 页码范围 227-228,231
页数 3页 分类号 TN495
字数 2540字 语种 中文
DOI 10.3969/j.issn.1000-3428.2007.07.082
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 石敏 暨南大学电子工程系 37 149 7.0 10.0
2 易清明 暨南大学电子工程系 65 288 9.0 13.0
3 李松 暨南大学电子工程系 1 4 1.0 1.0
传播情况
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研究主题发展历程
节点文献
SOVA算法
Turbo译码器
硬件设计
优化
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
出版文献量(篇)
31987
总下载数(次)
53
总被引数(次)
317027
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