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摘要:
针对H.264视频编码标准关键技术52级标量量化的VLSI实现过程中,传统结构的速度和面积不能有效满足H.264在高速高并行编码应用中的实时要求,通过采用部分CSD码无符号压缩移位加法树、参考电平连线、对量化系数和步长重新进行分组分段编码等方法,有效替代了H.264标量量化过程中出现的矩阵乘法、查表、除法等不利于硬件加速的算法,提出了一种非常适合流水加速的基于4×4块并行的VLSI结构,通过控制级联加法器级数就可以有效调节其速度性能,当级数为2时,其块处理速率可以达到121.6 MHz, 能够满足4096×2304@120 Hz视频的实时处理要求.该结构在面积和功耗方面较传统结构也有较大的改进,采用SMIC 0.13 μm工艺单元库,综合时钟频率设为100 MHz时,等效门和功耗分别节省了38%和30%.
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头信息
码率控制
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文献信息
篇名 一种新的H.264/AVC标量量化并行VLSI结构
来源期刊 北京大学学报(自然科学版) 学科 工学
关键词 H.264 VLSI结构 视频编码
年,卷(期) 2008,(4) 所属期刊栏目 研究论文
研究方向 页码范围 522-526
页数 5页 分类号 TN79
字数 1196字 语种 中文
DOI 10.3321/j.issn:0479-8023.2008.04.005
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 曹喜信 北京大学软件微电子学院 22 27 3.0 4.0
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研究主题发展历程
节点文献
H.264
VLSI结构
视频编码
研究起点
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期刊影响力
北京大学学报(自然科学版)
双月刊
0479-8023
11-2442/N
16开
北京海淀北京大学校内
2-89
1955
chi
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