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摘要:
FIR滤波器作为数字信号处理系统的基本模块,其性能的高低直接影响到数字信号处理系统实时处理信息的能力.本文根据FPGA的结构特点,介绍了一种改进型的FIR结构及乘法运算的分解算法.利用VHDL语言程序设计和QUARTUSII编译仿真,验证了所提算法实现的4、6、12阶FIR滤波器的运算速度分别提高169.5%、345.6%、616.8%.对FPGA资源的占用分别下降了16.7%、14.5%、13.7%.
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文献信息
篇名 一种改进型FIR滤波器设计与研究
来源期刊 电测与仪表 学科 工学
关键词 FIR滤波器 FPGA 信号处理 分解算法
年,卷(期) 2008,(3) 所属期刊栏目 电能质量、谐波检测及有源滤波
研究方向 页码范围 17-19
页数 3页 分类号 TM76
字数 1992字 语种 中文
DOI 10.3969/j.issn.1001-1390.2008.03.005
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 肖丽仙 10 64 4.0 8.0
2 何永泰 云南楚雄师范学院物理与电子科学系 2 2 1.0 1.0
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研究主题发展历程
节点文献
FIR滤波器
FPGA
信号处理
分解算法
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
电测与仪表
半月刊
1001-1390
23-1202/TH
大16开
哈尔滨市松北区创新路2000号
14-43
1964
chi
出版文献量(篇)
7685
总下载数(次)
22
总被引数(次)
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