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摘要:
利用随机信号理论,采用verilog语言设计一种基于FPGA的高斯噪声实时产生器.通过系统仿真分析,该方法可满足工程需要,且具有电路简单,模块化程度高的特点.
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文献信息
篇名 基于FPGA的高斯噪声实时产生方法
来源期刊 舰船电子工程 学科 工学
关键词 FPGA 噪声产生 信号仿真
年,卷(期) 2008,(6) 所属期刊栏目 模拟与仿真
研究方向 页码范围 124-125
页数 2页 分类号 TP391.9
字数 1167字 语种 中文
DOI 10.3969/j.issn.1627-9730.2008.06.034
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 卞小林 23 70 5.0 6.0
2 席泽敏 73 291 9.0 12.0
3 刘峰 23 125 7.0 10.0
4 何宏斌 2 11 1.0 2.0
传播情况
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2019(2)
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  • 二级引证文献(2)
研究主题发展历程
节点文献
FPGA
噪声产生
信号仿真
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
舰船电子工程
月刊
1672-9730
42-1427/U
大16开
湖北省武汉市
1981
chi
出版文献量(篇)
9053
总下载数(次)
18
总被引数(次)
27655
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