原文服务方: 科技与创新       
摘要:
在FPGA调试或者应用过程中,通常利用JTAG接口将目标文件从PC下载到FPGA的SRAM中以实现配置,使得FPGA的调试和应用无法脱离存储在PC中的目标文件和Quartus软件,从而降低了FPGA调试和使用的灵活性.本文主要讨论和构造了一种新颖的FPGA配置方案,使用CPLD作为配置方案中的关键控制单元,极大方便和灵活地实现对于FPGA的配置,这将使基于FPGA的设计和调试更加简便和可靠.
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文献信息
篇名 一种新颖的多模式FPGA配置方案
来源期刊 科技与创新 学科
关键词 CPLD FLASH FPGA 配置 串口 并口
年,卷(期) 2008,(29) 所属期刊栏目 PLD CPLD FPGA应用
研究方向 页码范围 179-181
页数 3页 分类号 TN431.2
字数 语种 中文
DOI 10.3969/j.issn.1008-0570.2008.29.072
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 吴斌 中国科学院微电子研究所 161 2294 16.0 45.0
2 黑勇 中国科学院微电子研究所 86 477 11.0 16.0
3 乔树山 中国科学院微电子研究所 53 272 9.0 14.0
4 毛剑慧 中国科学院微电子研究所 6 46 3.0 6.0
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研究主题发展历程
节点文献
CPLD
FLASH
FPGA
配置
串口
并口
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
科技与创新
半月刊
2095-6835
14-1369/N
大16开
2014-01-01
chi
出版文献量(篇)
41653
总下载数(次)
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总被引数(次)
202805
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