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摘要:
〈Verilog HDL语言程序设计〉已经成为电子工程类的大学本科高年级的一门必修课.该门课程的教学质量直接影响电子工程类专业的培养目标.本文从提高学生兴趣、互动教学、创建学习环境三方面探讨了〈Verilog HDL语言程序设计〉的教学改革.
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文献信息
篇名 《Verilog HDL语言程序设计》课程教学探讨
来源期刊 福建电脑 学科 教育
关键词 Verilog HDL 语言 兴趣 教学改革
年,卷(期) 2008,(4) 所属期刊栏目 教学与管理
研究方向 页码范围 207,201
页数 2页 分类号 G71
字数 1889字 语种 中文
DOI 10.3969/j.issn.1673-2782.2008.04.130
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作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 周正华 2 6 1.0 2.0
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2017(1)
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研究主题发展历程
节点文献
Verilog HDL
语言
兴趣
教学改革
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
福建电脑
月刊
1673-2782
35-1115/TP
大16开
福州市华林邮局29号信箱
1985
chi
出版文献量(篇)
21147
总下载数(次)
86
总被引数(次)
44699
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