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摘要:
Fano译码算法一般采用软件实现,受制于计算机的结构,译码速度较慢.为大幅度提高译码速度,研究软判决Fano译码算法的全硬件实现方案,即采用AHDL(Altera硬件描述语言)设计软判决Fano译码译码器,使用FPGA(现场可编程门阵列)予以实现.介绍了总体结构,重点描述构建Fano软判决译码器关键部件--状态机的设计.实测数据表明,在相同时钟频率条件下,软判决Fano译码算法的全硬件实现比软件方案至少快20倍.
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文献信息
篇名 软判决Fano译码算法的FPGA实现
来源期刊 信息化研究 学科 工学
关键词 Fano算法 序列译码 FPGA
年,卷(期) 2009,(10) 所属期刊栏目 研究与设计
研究方向 页码范围 14-17
页数 4页 分类号 TN911.2
字数 3079字 语种 中文
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研究主题发展历程
节点文献
Fano算法
序列译码
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
信息化研究
双月刊
1674-4888
32-1797/TP
大16开
江苏省南京市
28-251
1975
chi
出版文献量(篇)
4494
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