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摘要:
在我国的数字电视广播地面传榆标准DMB-T中,使用了准循环非规则LDPC码作为前向纠错编码.针对此标准中LDPc码的特点,采用修正最小和译码算法,设计了一种半并行结构实时译码器,可实现DMB-T中三种不同码率下的LDPC译码,并有效地实现了硬件结构复用.与其他设计方案相比较,减少了RAM块的数量一半以上,全局布线难度也大大降低.整个设计在Stmtix Ⅱ FPGA上进行了综合验证.当译码迭代次数为20次时,系统吞吐量可达100 Mb/s以上.
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文献信息
篇名 数字电视标准DMB-T高速LDPC译码器VLSI设计
来源期刊 计算机工程与应用 学科 工学
关键词 低密度奇偶校验码 数字电视广播地面传输标准 修正最小和算法 半并行译码器
年,卷(期) 2009,(11) 所属期刊栏目 研发、设计、测试
研究方向 页码范围 77-81
页数 5页 分类号 TN911
字数 5532字 语种 中文
DOI 10.3778/j.issn.1002-8331.2009.11.023
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 王鹏 同济大学通信软件及专用集成电路设计中心 91 943 17.0 29.0
2 陈咏恩 同济大学通信软件及专用集成电路设计中心 42 175 7.0 10.0
传播情况
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研究主题发展历程
节点文献
低密度奇偶校验码
数字电视广播地面传输标准
修正最小和算法
半并行译码器
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程与应用
半月刊
1002-8331
11-2127/TP
大16开
北京619信箱26分箱
82-605
1964
chi
出版文献量(篇)
39068
总下载数(次)
102
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390217
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