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时序逻辑电路设计时的状态化简
原文服务方：
科学之友
摘要：
时序逻辑电路的一般设计是数字电路设计的重要方面,在设计过程中的状态化简是设计结果是否最佳的关键环节.文章就状态等效的基本概念、状态化简的步骤作了详细的介绍.
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科学之友
主办单位：
山西省科学技术协会
出版周期：
月刊
ISSN：
1000-8136
CN：
14-1032/N
开本：
大16开
出版地：
邮发代号：
创刊时间：
1980-01-01
语种：
chi
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23322
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