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基于CPLD多功能数字钟的优化设计
基于CPLD多功能数字钟的优化设计
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摘要：
针对CPLD设计优化的问题,研究了如何在系统级及模块级对电路进行优化.通过系统级采用精简输入输出电路结构和模块级采用资源共享,逻辑优化等方法在CPLD芯片EPM7128SLC84-15上实现一个带有清零和校时的数字钟.综合之后,使用了112个LC,占总资源的87%,硬件电路运行稳定准确.
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文献信息
| 篇名 | 基于CPLD多功能数字钟的优化设计 | ||
| 来源期刊 | 南京工业职业技术学院学报 | 学科 | 工学 |
| 关键词 | CPLD EPM7128 数字钟 优化 LC | ||
| 年，卷（期） | 2010,（2） | 所属期刊栏目 | |
| 研究方向 | 页码范围 | 36-38 | |
| 页数 | 分类号 | TN79 | |
| 字数 | 2116字 | 语种 | 中文 |
| DOI | 10.3969/j.issn.1671-4644.2010.02.013 | ||
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研究主题发展历程
节点文献
CPLD
EPM7128
数字钟
优化
LC
研究起点
研究来源
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引文网络交叉学科
相关学者/机构
期刊影响力
南京工业职业技术学院学报
主办单位：
南京工业职业技术学院
出版周期：
季刊
ISSN：
1671-4644
CN：
32-1635/Z
开本：
出版地：
南京市仙林大学城羊山北路1号
邮发代号：
创刊时间：
语种：
chi
出版文献量（篇）
2046
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