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采用微捷码工具处理65纳米设计时序收敛问题(上)
采用微捷码工具处理65纳米设计时序收敛问题(上)
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摘要：
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一种深亚微米复杂芯片物理设计的时序收敛方法
深亚微米
时序收敛
连线延时
串扰效应
具有快速译码收敛速度的LDPC码设计
LDPC码
快速收敛
误码性能
串行译码
深亚微米SoC芯片物理设计中基于串扰的时序收敛方法
深亚微米
串扰
时序收敛
时序逻辑电路设计时的状态化简
状态等效
等效类
隐含表
内容分析
关键词云
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文献信息
| 篇名 | 采用微捷码工具处理65纳米设计时序收敛问题(上) | ||
| 来源期刊 | 中国电子商情·基础电子 | 学科 | |
| 关键词 | |||
| 年，卷（期） | 2010,（5） | 所属期刊栏目 | |
| 研究方向 | 页码范围 | 45-47 | |
| 页数 | 分类号 | ||
| 字数 | 2805字 | 语种 | 中文 |
| DOI | |||
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中国电子商情·基础电子
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