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摘要:
ARINC659 总线与机载计算机PCI9054 接口设计中因工作时钟不同而出现亚稳态现象.为此,描述亚稳态机理,给出降低亚稳态产生条件,提出采用同步器实现控制信号传递和格雷码+异步FIFO 实现数据传输.结合PCI9054 接口信号时序,设计总线接口模块,通过Verilog 编码实现进行仿真实验.结果表明,异步FIFO 解决了ARINC659 与PCI9054 之间的跨时钟数据传输.
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文献信息
篇名 ARINC659总线接口跨时钟的研究与设计
来源期刊 计算机工程 学科 工学
关键词 ARINC659总线 跨时钟 亚稳态 异步FIFO
年,卷(期) 2010,(20) 所属期刊栏目
研究方向 页码范围 214-216
页数 分类号 TP336
字数 2340字 语种 中文
DOI 10.3969/j.issn.1000-3428.2010.20.075
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 樊晓桠 西北工业大学航空微电子中心 170 1393 17.0 29.0
2 安建峰 西北工业大学航空微电子中心 25 103 6.0 8.0
3 何向栋 西北工业大学航空微电子中心 1 3 1.0 1.0
传播情况
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研究主题发展历程
节点文献
ARINC659总线
跨时钟
亚稳态
异步FIFO
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
出版文献量(篇)
31987
总下载数(次)
53
总被引数(次)
317027
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