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摘要:
提出一种应用于NAND Flash控制器的并行BCH编/译码器,在译码阶段引入流水线操作和分组预取译码操作,提升BCH码的译码效率.实验结果表明,在NAND Flash的2 KB页读取操作中,该编/译码器纠正8 bit的随机错误只需要565个周期的译码时间,是采用按页预取译码方式所需时间的1/4.
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一种含BCH编解码器的SLC/MLC NAND FLASH控制器的VLSI设计
MLC NANDFLASH控制器
BCH
编解码
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VLSI
支持ONFI协议的NAND Flash控制器设计
固态硬盘
控制器
NANDFlash
ONFI协议
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文献信息
篇名 NAND Flash控制器的BCH编/译码器设计
来源期刊 计算机工程 学科 工学
关键词 BCH码 并行 流水线 NAND Flash控制器 分组预取译码
年,卷(期) 2010,(16) 所属期刊栏目
研究方向 页码范围 222-225
页数 分类号 TP309.2
字数 3644字 语种 中文
DOI 10.3969/j.issn.1000-3428.2010.16.080
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 王杰 浙江大学超大规模集成电路设计研究所 93 429 13.0 18.0
2 沈海斌 浙江大学超大规模集成电路设计研究所 139 832 13.0 21.0
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研究主题发展历程
节点文献
BCH码
并行
流水线
NAND Flash控制器
分组预取译码
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
出版文献量(篇)
31987
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53
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