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摘要:
随着芯片设计向更高的频率发展,传统的时钟树综合策略是尽量减小时钟偏移,但是这样的时钟树综合策略已经逐渐不能满足时序收敛的需要,因此引入了有效时钟偏移的概念.文章通过一个在,TSMC 0.13μm工艺并流片成功的芯片BES7000作为设计实例,分析了有效时钟偏移引入之后对改进时序建立时间的效果.
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文献信息
篇名 时钟树综合中的有效时钟偏移
来源期刊 空间电子技术 学科 工学
关键词 时钟树综合 有效时钟偏移 时序收敛
年,卷(期) 2011,(1) 所属期刊栏目
研究方向 页码范围 68-70
页数 分类号 TP3
字数 2196字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 于忠臣 北京工业大学北京市嵌入式系统重点实验室 38 77 4.0 8.0
2 林晓 北京工业大学北京市嵌入式系统重点实验室 3 4 1.0 2.0
传播情况
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引文网络
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1995(1)
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研究主题发展历程
节点文献
时钟树综合
有效时钟偏移
时序收敛
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
空间电子技术
双月刊
1674-7135
61-1420/TN
大16开
西安市165信箱
1971
chi
出版文献量(篇)
1737
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9
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6261
论文1v1指导