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摘要:
提出了基于FPLA的染色体编码及在此基础上的并行硬件进化方法.该编码方式以与或非门为基本单元,进化时将电路编码染色体按逻辑门分解,进行适应度计算时采用分解逆过程使染色体合并,可以有效缩短进化时间,有利于大规模复杂电路的进化.以4位二进制码转换为格雷码的电路为例进行试验,该方法在20次实验中平均速度提高了32.25%.为实现内进化编写了由染色体生成Vefilog硬件语言的C程序,该编码方式同时适用于多输入多输出电路进化且染色体长度可变,利用此特性生成了异构电路,完成了容错,对于实现故障模块在线修复,提高太空恶劣环境中电子系统可靠性具有一定意义.
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文献信息
篇名 一种染色体编码新方法的硬件进化
来源期刊 智能系统学报 学科 工学
关键词 硬件进化 染色体编码 FPLA Verilog硬件语言
年,卷(期) 2011,(5) 所属期刊栏目
研究方向 页码范围 450-455
页数 分类号 TP18|TP302.8
字数 3700字 语种 中文
DOI 10.3969/j.issn.1673-4785.2011.05.010
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 刘峥 西安电子科技大学雷达信号处理国家重点实验室 102 847 16.0 24.0
2 张超 西安电子科技大学雷达信号处理国家重点实验室 50 507 10.0 21.0
3 赵伟 西安电子科技大学雷达信号处理国家重点实验室 17 105 6.0 9.0
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研究主题发展历程
节点文献
硬件进化
染色体编码
FPLA
Verilog硬件语言
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
智能系统学报
双月刊
1673-4785
23-1538/TP
大16开
哈尔滨市南岗区南通大街145-1号楼
2006
chi
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12401
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