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摘要:
以(8 176,7 154)准循环码为研究对象,介绍了准循环低密度奇偶校验(LDPC)码及其译码算法,分析了译码器的硬件结构单元,并详细介绍了各个分块单元。在Xilinx公司的硬件上仿真实现了所设计的译码器,并在平台上对其进行测试。仿真结果表明所设计的高速译码器编码效率为7/8,吞吐量达到600 Mbps,在高速数数据传输系统中具有重大的工程应用价值。
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IEEE 802.1 6e中LDPC译码器的实现
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IEEE
802.16e
LDPC译码器
部分并行
FPGA
内容分析
关键词云
关键词热度
相关文献总数  
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文献信息
篇名 高速LDPC码译码器的实现技术分析
来源期刊 无线电工程 学科 工学
关键词 高速信道编译码 LDPC 部分并行处理
年,卷(期) 2011,(9) 所属期刊栏目 信号与信息处理
研究方向 页码范围 28-30
页数 分类号 TN919.3
字数 1854字 语种 中文
DOI 10.3969/j.issn.1003-3106.2011.09.009
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 魏瑞刚 中国电子科技集团公司第五十四研究所 5 25 2.0 5.0
2 孙学士 2 20 2.0 2.0
传播情况
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引文网络
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二级参考文献  (4)
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2018(2)
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研究主题发展历程
节点文献
高速信道编译码
LDPC
部分并行处理
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
无线电工程
月刊
1003-3106
13-1097/TN
大16开
河北省石家庄市174信箱215分箱
18-150
1971
chi
出版文献量(篇)
5453
总下载数(次)
12
总被引数(次)
20875
论文1v1指导