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DVB-C系统中RS编码器的设计与实现
DVB-C系统中RS编码器的设计与实现
作者:
蒋丽
高松
原文服务方:
广东通信技术
RS编码器
有限域
MODELSIM
FPGA
摘要:
详细介绍了 DVB-C 系统中 RS 编码器的工作原理,介绍了有限域常数乘法器的实现方法;首先,通过编写 M 文件实现RS(204,188)编码器并在 MATLAB 中对其进行模拟仿真,然后,采用 VHDL 语言编写 RS 编码器的 RTL 代码并在 MODELSIM 中对其进行功能仿真,最后,对两种测试环境下的仿真结果进行了对比和分析,并给出了仿真结果图;通过 Quams II 编译之后,最终在 FPGA 上实现.
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内容分析
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文献信息
篇名
DVB-C系统中RS编码器的设计与实现
来源期刊
广东通信技术
学科
关键词
RS编码器
有限域
MODELSIM
FPGA
年,卷(期)
2011,(2)
所属期刊栏目
技术交流
研究方向
页码范围
63-65,74
页数
分类号
TN91
字数
语种
中文
DOI
10.3969/j.issn.1006-6403.2011.02.017
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蒋丽
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节点文献
RS编码器
有限域
MODELSIM
FPGA
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
广东通信技术
主办单位:
广东省通信学会
出版周期:
月刊
ISSN:
1006-6403
CN:
44-1221/TN
开本:
大16开
出版地:
邮发代号:
创刊时间:
1981-01-01
语种:
chi
出版文献量(篇)
4474
总下载数(次)
0
总被引数(次)
11090
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