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摘要:
针对图像缩放的不同要求,提出一种分步插值图像缩放器结构.对行列在空间上分开,在时间上同步,在开始的K(选择不同的算法K值不同)行行列串行处理,先进行行缩放,再用新生成的像素点进行列操作,K行处理完后,行列并行处理.这种结构使得图像缩放时并行度得到提升,由于行列分开处理使得对于不同要求的场合行列可以采用相同或不同的算法以达到特定的要求.实验表明,该分步式插值电路架构既节省了资源、降低了开销,又提高了图像质量.
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文献信息
篇名 图像缩放的研究与FPGA设计
来源期刊 计算机技术与发展 学科 工学
关键词 图像缩放 Catmull_Rom 分步插值
年,卷(期) 2011,(12) 所属期刊栏目 应用开发研究
研究方向 页码范围 205-208
页数 分类号 TP391.4
字数 2580字 语种 中文
DOI 10.3969/j.issn.1673-629X.2011.12.055
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 蒋林 西安邮电学院电子工程学院 85 264 8.0 10.0
2 杨飞 西安邮电学院电子工程学院 9 58 5.0 7.0
3 吕荣国 西安邮电学院电子工程学院 1 9 1.0 1.0
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研究主题发展历程
节点文献
图像缩放
Catmull_Rom
分步插值
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机技术与发展
月刊
1673-629X
61-1450/TP
大16开
西安市雁塔路南段99号
52-127
1991
chi
出版文献量(篇)
12927
总下载数(次)
40
总被引数(次)
111596
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