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摘要:
介绍了一种基于CPLD+ ARM的多道脉冲幅度分析器的设计方案.通过在CPLD内建立FIFO缓存队列,使数据采集和脉冲幅度分析速度协调,提高核脉冲的通过率;采用STM32F10X固件库开发多道分析器软件,可缩短软件开发周期;高集成度、低功耗器件的应用有助于降低多道分析器的功耗并有利于其小型化.CPLD+ ARM的实现方案体现出一定的优势.
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文献信息
篇名 基于CPLD+ARM的多道脉冲幅度分析器设计
来源期刊 核电子学与探测技术 学科 工学
关键词 多道脉冲幅度分析器 峰值检测 CPLD FIFO Cortex-M3
年,卷(期) 2012,(1) 所属期刊栏目
研究方向 页码范围 91-94
页数 分类号 TL822.4
字数 2144字 语种 中文
DOI 10.3969/j.issn.0258-0934.2012.01.020
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 魏秋菊 8 52 5.0 7.0
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研究主题发展历程
节点文献
多道脉冲幅度分析器
峰值检测
CPLD FIFO
Cortex-M3
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
核电子学与探测技术
双月刊
0258-0934
11-2016/TL
大16开
北京市经济技术开发区宏达南路3号
1981
chi
出版文献量(篇)
5579
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9
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