原文服务方: 现代电子技术       
摘要:
称为第3代I/O接口技术的PCI Express总线规范的出现,从结构上解决了带宽不足的问题,有着极为广阔的发展前景.基于Verilog HDL硬件描述语言及可综合化设计理念,完成了PCI Express IP核RTL代码的设计.IP核代码使用Verilog HDL语言编写,分模块、分层次地设计了事务层、数据链路层和物理层的逻辑子层,并进行了可综合化设计与代码风格检查.对设计的PCI Express IP核的功能分别从协议层次和应用层次进行了验证.具体实现上,采用Denali公司的PureSuite测试套件对IP核的协议兼容性进行验证,验证范围覆盖了IP核的3个层次以及配置空间,采用QuestaSim仿真工具对IP核的应用层进行验证.仿真结果表明,设计的PCI Express IP核工作正常,性能优良.
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文献信息
篇名 PCI Express协议实现与验证
来源期刊 现代电子技术 学科
关键词 PCI Express协议 IP核 验证 1/O接口
年,卷(期) 2012,(4) 所属期刊栏目 总线与网络
研究方向 页码范围 123-125,127
页数 分类号 TN98-34
字数 语种 中文
DOI 10.3969/j.issn.1004-373X.2012.04.039
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 刘迪 海军航空工程学院控制工程系 54 237 7.0 13.0
2 张大为 海军航空工程学院控制工程系 31 124 5.0 9.0
3 梁宇琪 山东信息职业技术学院信息工程系 7 9 2.0 3.0
传播情况
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引文网络
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研究主题发展历程
节点文献
PCI Express协议
IP核
验证
1/O接口
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
现代电子技术
半月刊
1004-373X
61-1224/TN
大16开
1977-01-01
chi
出版文献量(篇)
23937
总下载数(次)
0
总被引数(次)
135074
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