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基于Radix-4Booth编码的乘法器优化设计
基于Radix-4Booth编码的乘法器优化设计
作者:
李峥
谢铁顿
陈海民
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
Radix-4 Booth编码
乘法器
部分积
关键路径延迟
芯片面积消耗
摘要:
传统Radix-4 Booth编码在负值部分积生成过程中会产生大量求补操作,影响乘法器的工作效率.为此,提出一种重组部分积的乘法器优化设计.通过增加一个“或”门运算以及重组硬连线,避免求补过程中的加法运算,并且未产生多余的部分积.在32位乘法器上的验证结果表明,该设计能有效减小关键路径延迟和芯片面积消耗.
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booth选择器
4-2压缩器
乘法器
部分积
内容分析
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文献信息
篇名
基于Radix-4Booth编码的乘法器优化设计
来源期刊
计算机工程
学科
工学
关键词
Radix-4 Booth编码
乘法器
部分积
关键路径延迟
芯片面积消耗
年,卷(期)
2012,(1)
所属期刊栏目
工程应用技术与实现
研究方向
页码范围
233-235
页数
分类号
TN492
字数
3533字
语种
中文
DOI
10.3969/j.issn.1000-3428.2012.01.076
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
李峥
解放军信息工程大学电子技术学院
27
114
6.0
9.0
2
陈海民
解放军信息工程大学电子技术学院
3
7
2.0
2.0
3
谢铁顿
河南财经政法大学成功学院
1
5
1.0
1.0
传播情况
被引次数趋势
(/次)
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引文网络
引文网络
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共引文献
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参考文献(1)
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1982(1)
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二级参考文献(1)
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二级引证文献(0)
2012(1)
引证文献(1)
二级引证文献(0)
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引证文献(1)
二级引证文献(0)
2014(2)
引证文献(1)
二级引证文献(1)
2015(2)
引证文献(1)
二级引证文献(1)
2016(8)
引证文献(1)
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2019(5)
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2020(1)
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研究主题发展历程
节点文献
Radix-4 Booth编码
乘法器
部分积
关键路径延迟
芯片面积消耗
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
主办单位:
华东计算技术研究所
上海市计算机学会
出版周期:
月刊
ISSN:
1000-3428
CN:
31-1289/TP
开本:
大16开
出版地:
上海市桂林路418号
邮发代号:
4-310
创刊时间:
1975
语种:
chi
出版文献量(篇)
31987
总下载数(次)
53
总被引数(次)
317027
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