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MIPS体系结构单周期CPU的设计
MIPS体系结构单周期CPU的设计
作者:
张泽生
蔡晓燕
袁春风
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
CPU设计
指令系统
数据通路
Verilog HDL
摘要:
本文首先从MIPS体系结构的指令系统中选出39条整数指令,具体介绍了执行这些指令所需要的单元电路及其结构,并完成了这些单元电路;在此基础之上,详细分析了不同类型的指令在执行过程中所经过的数据通路,根据不同类型指令的数据通路,将这些单元电路连接起来,构成了完整的单周期CPU数据通路;最后用Verilog HDL语言完成了一个能够执行所有这些指令的单周期CPU电路描述,并通过Modelsim仿真工具对其进行仿真,验证了此单周期CPU的功能.
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文献信息
篇名
MIPS体系结构单周期CPU的设计
来源期刊
高性能计算技术
学科
工学
关键词
CPU设计
指令系统
数据通路
Verilog HDL
年,卷(期)
2013,(6)
所属期刊栏目
高性能计算技术
研究方向
页码范围
62-66
页数
5页
分类号
TP332
字数
语种
中文
DOI
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
袁春风
南京大学计算机科学与技术系
51
926
18.0
29.0
2
张泽生
南京大学计算机科学与技术系
6
68
4.0
6.0
3
蔡晓燕
南京大学计算机科学与技术系
7
62
4.0
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参考文献(0)
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研究主题发展历程
节点文献
CPU设计
指令系统
数据通路
Verilog HDL
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
高性能计算技术
主办单位:
中国人民解放军总参第五十六研究所
出版周期:
双月刊
ISSN:
CN:
32-1679/TP
开本:
出版地:
江苏省无锡33信箱353号
邮发代号:
创刊时间:
语种:
chi
出版文献量(篇)
1235
总下载数(次)
12
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