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摘要:
描述了一种适用于便携式数字辐射探测仪前端读出电路的高速、低功耗、噪声性能优良的滤波成形电路的设计.在铭记功耗、噪声设计指标的同时,通过模拟分析的方法,变换准高斯CR-(RC)n滤波成形器的阶数n和成形时间,优化电路的计数率.该滤波成形器利用工作在弱反型区MOS管的特性,实现运算放大器的低功耗设计,并引入嵌套式反馈回路,在保证噪声性能的基础上,获得可消除输出过冲的带宽.芯片采用华润上华0.5DPDM工艺制造,成型时间达到250ns(Cdet=20 pf),最大计数率可达500 kcps,等效噪声电荷(ENC)为453ē,功耗仅为34.5 μW.
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文献信息
篇名 一种高速、低功耗滤波成形电路设计
来源期刊 核电子学与探测技术 学科 工学
关键词 滤波成形器 计数率最优化 弱反型区 嵌套式反馈回路
年,卷(期) 2013,(2) 所属期刊栏目
研究方向 页码范围 257-262
页数 6页 分类号 TN4
字数 2850字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 于宗光 江南大学物联网工程学院 89 354 9.0 14.0
5 周云波 江南大学物联网工程学院 4 9 2.0 2.0
6 单悦尔 江南大学物联网工程学院 4 12 3.0 3.0
10 曹华锋 江南大学物联网工程学院 3 8 2.0 2.0
11 杨煜 江南大学物联网工程学院 2 4 2.0 2.0
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研究主题发展历程
节点文献
滤波成形器
计数率最优化
弱反型区
嵌套式反馈回路
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
核电子学与探测技术
双月刊
0258-0934
11-2016/TL
大16开
北京市经济技术开发区宏达南路3号
1981
chi
出版文献量(篇)
5579
总下载数(次)
9
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