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基于Verilog的偶数分频器设计
基于Verilog的偶数分频器设计
作者:
童雪琴
董海青
基本信息来源于合作网站,原文需代理用户跳转至来源网站获取
偶数分频器
硬件描述语言(HDL)
综合
摘要:
分频器是数字电路设计中常用的基本电路.文章采用Verilog HDL语言利用现场可编程门阵列(FPGA)设计分频器,并应用电子设计自动化工具对不同的描述方式分别进行仿真和综合,通过对源代码和逻辑电路的分析比较,证明源代码的编写结构决定逻辑电路的复杂程度.
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篇名
基于Verilog的偶数分频器设计
来源期刊
信息化研究
学科
工学
关键词
偶数分频器
硬件描述语言(HDL)
综合
年,卷(期)
2013,(5)
所属期刊栏目
技术与应用
研究方向
页码范围
56-59
页数
4页
分类号
TN772
字数
语种
中文
DOI
五维指标
作者信息
序号
姓名
单位
发文数
被引次数
H指数
G指数
1
董海青
17
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童雪琴
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偶数分频器
硬件描述语言(HDL)
综合
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
信息化研究
主办单位:
江苏省电子学会
出版周期:
双月刊
ISSN:
1674-4888
CN:
32-1797/TP
开本:
大16开
出版地:
江苏省南京市
邮发代号:
28-251
创刊时间:
1975
语种:
chi
出版文献量(篇)
4494
总下载数(次)
11
总被引数(次)
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