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摘要:
对于片上系统(SoC)架构设计,寄存器传送级建模仿真速度慢,而采用C语言建模达不到所需的精度要求.针对上述问题,基于电子系统级(ESL)设计方法,提出一种通用的周期精确/位精确的高速缓存(Cache)事务级模型.该模型面向外部接口和内部逻辑分别采用不同的抽象层次进行建模,并构建基于ESL设计的SoC,实现软硬件协同设计.实验结果表明,集成Cache模块的仿真平台运行相应程序所需周期数大幅减少,可达到既定的精度要求.
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内容分析
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文献信息
篇名 周期精确/位精确的Cache事务级建模方法
来源期刊 计算机工程 学科 工学
关键词 高速缓存 电子系统级设计 事务级建模 片上系统架构设计 周期精确 软/硬件协同设计
年,卷(期) 2013,(8) 所属期刊栏目 体系结构与软件技术
研究方向 页码范围 74-76,82
页数 4页 分类号 TP316
字数 3389字 语种 中文
DOI 10.3969/j.issn.1000-3428.2013.08.015
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 郭炜 天津大学计算机科学与技术学院 27 163 6.0 11.0
2 魏继增 天津大学计算机科学与技术学院 17 36 3.0 5.0
3 周红月 天津大学计算机科学与技术学院 2 5 1.0 2.0
4 孙铭泽 天津大学计算机科学与技术学院 2 4 1.0 2.0
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研究主题发展历程
节点文献
高速缓存
电子系统级设计
事务级建模
片上系统架构设计
周期精确
软/硬件协同设计
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
出版文献量(篇)
31987
总下载数(次)
53
总被引数(次)
317027
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