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摘要:
针对分组密码算法SM4中加解密算法与密钥扩展算法的相似性,提出一种将加解密模块与密钥扩展模块复用的基本架构,通过对具体实现结构的分析与选择,使控制逻辑复杂度、复用模块复杂度以及系统吞吐量之间得到权衡。基于该架构设计SM4加解密IP核,在现场可编程门阵列上占用的资源仅为传统设计的55%,基于SMIC 0.18μm数字CMOS工艺的综合结果显示,仅用0.079 mm2即可实现100 Mb/s的数据吞吐量。实验结果表明,该结构可以有效地降低SM4算法的实现复杂度。
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文献信息
篇名 分组密码算法SM4的低复杂度实现
来源期刊 计算机工程 学科 工学
关键词 SM4算法 分组密码算法 低复杂度 硬件复用 现场可编程门阵列 特定用途集成电路实现
年,卷(期) 2013,(7) 所属期刊栏目 安全技术
研究方向 页码范围 177-180
页数 4页 分类号 TP331
字数 3939字 语种 中文
DOI 10.3969/j.issn.1000-3428.2013.07.040
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 黑勇 中国科学院微电子研究所 86 477 11.0 16.0
2 乔树山 中国科学院微电子研究所 53 272 9.0 14.0
3 王晨光 中国科学院微电子研究所 11 100 5.0 10.0
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研究主题发展历程
节点文献
SM4算法
分组密码算法
低复杂度
硬件复用
现场可编程门阵列
特定用途集成电路实现
研究起点
研究来源
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引文网络交叉学科
相关学者/机构
期刊影响力
计算机工程
月刊
1000-3428
31-1289/TP
大16开
上海市桂林路418号
4-310
1975
chi
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