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摘要:
通过对SATA协议和扰码原理的分析,在串行扰码的基础上,实现了一种基于SATA接口的并行32 bit扰码和解扰算法.数据传输速度快、时延小、更稳定,并行扰码比串行扰码能更好地满足SATA接口的高速传输时序.最后在FPGA上使用VHDL语言编程,对模块进行了验证.
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并行扰码模块的FPGA设计
扰码
并行
FPGA
串行
内容分析
关键词云
关键词热度
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文献信息
篇名 基于SATA接口的并行扰码实现
来源期刊 电视技术 学科 工学
关键词 SATA 扰码 解扰 并行算法 并行扰码 FPGA
年,卷(期) 2013,(19) 所属期刊栏目 器件与应用
研究方向 页码范围 71-73,90
页数 4页 分类号 TN919.3
字数 2282字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 何小海 四川大学电子信息学院图像信息研究所 395 2334 21.0 30.0
2 卿粼波 四川大学电子信息学院图像信息研究所 181 565 11.0 15.0
3 孟勇 四川大学电子信息学院图像信息研究所 10 99 6.0 9.0
4 杨龙 四川大学电子信息学院图像信息研究所 10 80 6.0 8.0
5 陈序 四川大学电子信息学院图像信息研究所 3 11 1.0 3.0
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SATA
扰码
解扰
并行算法
并行扰码
FPGA
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