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摘要:
提出了一种汉明码译码器改进方法,采用串行数据传输和时序优化的方法来降低汉明码译码器占用的资源和成本,并采用模块式的设计方法,设计了编译码系统仿真平台,详细地阐述了整个系统和各个模块的FPGA实现过程.仿真结果表明,设计的译码器复杂度明显降低.
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文献信息
篇名 一种改进的汉明码译码器设计与FPGA验证
来源期刊 电视技术 学科 工学
关键词 汉明码 译码器 串行数据传输 时序优化 FPGA
年,卷(期) 2013,(17) 所属期刊栏目 传输与接收
研究方向 页码范围 232-235
页数 4页 分类号 TN919.3
字数 1365字 语种 中文
DOI
五维指标
作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 梁天宇 重庆邮电大学光纤通信技术重点实验室 13 33 3.0 5.0
2 何丽 重庆邮电大学光纤通信技术重点实验室 7 10 1.0 3.0
3 田凯 重庆邮电大学光纤通信技术重点实验室 6 4 1.0 2.0
4 田方方 重庆邮电大学光纤通信技术重点实验室 5 1 1.0 1.0
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研究主题发展历程
节点文献
汉明码
译码器
串行数据传输
时序优化
FPGA
研究起点
研究来源
研究分支
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期刊影响力
电视技术
月刊
1002-8692
11-2123/TN
大16开
北京市朝阳区酒仙桥北路乙7号(北京743信箱杂志社)
2-354
1977
chi
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