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摘要:
介绍了常用的水平垂直冗余校验码---(7×7)奇偶校验编码解码逻辑电路的EDA 设计,用V HDL语言对(7×7)奇偶校验编码器和解码器进行描述,用Quartus II软件进行仿真测试。从仿真结果看,电路完全符合要求,可以烧写成芯片。
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文献信息
篇名 (7×7)奇偶校验电路的EDA设计
来源期刊 山东理工大学学报(自然科学版) 学科 工学
关键词 信道编码 奇偶校验 电路设计 EDA软硬件设计
年,卷(期) 2014,(1) 所属期刊栏目
研究方向 页码范围 58-64
页数 7页 分类号 TN492
字数 2954字 语种 中文
DOI
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作者信息
序号 姓名 单位 发文数 被引次数 H指数 G指数
1 严添明 黎明职业大学信息与电子工程学院 2 0 0.0 0.0
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研究主题发展历程
节点文献
信道编码
奇偶校验
电路设计
EDA软硬件设计
研究起点
研究来源
研究分支
研究去脉
引文网络交叉学科
相关学者/机构
期刊影响力
山东理工大学学报(自然科学版)
双月刊
1672-6197
37-1412/N
大16开
山东省淄博市张周路12号
1985
chi
出版文献量(篇)
2724
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4
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12440
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